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Debug of RISC-V,创芯大讲堂,EETOP,本课程依据RISC-V的debug 规范文档,围绕常用的处理器调试方式的硬件设计展开。重点讲述RISC-V调试的系统结构及硬件组成,处理器调试功能中的常用的断点设置,单步执行的实现,以及调试软件控制和访问处理器以及系统硬件资源的实现方式。并介绍了RISC-V调试规范中关于security方面的考虑。 适用人群:处理器硬件设计工程师,系统调试及软件开发工程师
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